10.3969/j.issn.1004-3365.2006.04.004
采用异步实现的快速傅里叶变换处理器
介绍一种采用异步实现结构的快速傅里叶变换处理器,该处理器的控制采用本地握手信号取代传统的系统时钟.给出了处理器中异步加法器的电路结构,设计了一个采用Booth译码Wallace tree结构的异步乘法器.通过对一个8点的异步快速傅里叶变换处理器进行电路仿真,得到该处理器完成一次变换的平均响应时间为31.15 ns,仅为最差响应时间42.85 ns的72.7%.可见,采用异步方式的快速傅里叶变换处理器在性能方面较同步处理器存在优势.
异步集成电路、异步数据通路、异步乘法器、快速傅里叶变换
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TN402(微电子学、集成电路（IC）)
中国科学院资助项目90307004
2006-09-11（万方平台首次上网日期，不代表论文的发表时间）
共4页
396-399
