10.3969/j.issn.1004-3365.1999.06.009
适用于MPEG2视频解码的VLD设计
提出了一种新的适用于MPEG2视频解码的变字长解码(VLD)结构,根据MPEG2变字长码表的特点,通过合理的码字分割解决码字的存储问题,采用桶式移位器,使得每个时钟能处理一个码字.由于比特流中最长的码长为24比特,故采用32位的内部总线结构,减小了电路规模.用1.0μm CMOS单元库进行综合,在50MHz时钟频率下工作时电路规模为6000门左右.
专用集成电路、视频解码、变字长解码、DCT系数、MPEG2
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TN764(基本电子电路)
2004-02-20(万方平台首次上网日期,不代表论文的发表时间)
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